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52
SM3性能优化.md
52
SM3性能优化.md
@ -1,9 +1,12 @@
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最近对SM3的性能进行了优化,主要包括:
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* 纯golang版本,减少W,W'预计算;避免使用条件判断。
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* 三月初实现了针对AMD64架构的ASM版本。
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下一步,看看能否实现使用AVX2指令集进行优化。
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# SHA256 SIMD Execution
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下面是SHA256 message scheduler SIMD实现,四轮算出下一个4个DWORDs.
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// Wt = SIGMA1(Wt-2) + Wt-7 + SIGMA0(Wt-15) + Wt-16; for 16 <= t <= 63
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@ -51,13 +54,16 @@
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VPADDD XTMP0, XTMP5, XDWORD0; \ // XDWORD0 = {W[3], W[2], W[1], W[0]}
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SM3的message scheduler有两个显著差别:
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1. Wi+3依赖Wi,所以也和SHA256类似,不能一次生成四个DWORDs,但和SHA256不完全一样。
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1. 比SHA256需要多算4个DWORDs。
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Intel 指令参考:
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https://software.intel.com/sites/landingpage/IntrinsicsGuide/
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SM3的第一版,比SHA256复杂:
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# SM3 SIMD Execution
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SM3的第一版,比SHA256复杂,不知道有没有继续优化的空间。
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// Wj ← P1(Wj−16 ⊕ Wj−9 ⊕ (Wj−3 ≪ 15)) ⊕ (Wj−13 ≪ 7) ⊕ Wj−6
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// Transpose data into high/low parts
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@ -107,3 +113,47 @@ SM3的第一版,比SHA256复杂:
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VPALIGNR $8, XTMP1, XTMP2, XTMP3; \ // XTMP3 = {W[1], W[0], W[3], W[2]}
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VPSHUFD $0x4E, XTMP3, XDWORD0; \ // XDWORD0 = {W[3], W[2], W[1], W[0]}
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由于要算**52**个DWORDs,所以
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| Ingteger Execution | SIMD Execution |
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| ---------------------- | ---------------------------- |
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| Execute Rounds 0...15 | Compute Message DWORDs 16…31 |
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| Execute Rounds 16...31 | Compute Message DWORDs 32…47 |
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| Execute Rounds 32...47 | Compute Message DWORDs 48…63 |
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| Execute Rounds 48...63 | Compute Message DWORDs 64…67 |
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# 其它SIMD Execution
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SHA 256的64轮压缩计算中,对Kt + Wt 进行了并行计算
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VPADDD 0*32(TBL)(SRND*1), XDWORD0, XFER
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VMOVDQU XFER, (_XFER + 0*32)(SP)(SRND*1)
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SM3可以对Wt XOR Wt+4进行并行计算,
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VPXOR XDWORD0, XDWORD1, XFER
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VMOVDQU XFER, (_XFER + 0*32)(SP)(SRND*1)
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但其依然需要Wt, 如何传入和使用Wt呢?难道把Wt和Wt'一起放到栈,譬如W0,W1,W2,W3,W0',W1',W2',W3',
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VMOVDQU XDWORD0, (_XFER + 0*32)(SP)(SRND*1)
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VPXOR XDWORD0, XDWORD1, XFER
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VMOVDQU XFER, (_XFER + 1*32)(SP)(SRND*1)
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没有大改变SHA 256 AVX2的主流程,但是栈的处理需要改变。
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# T常量处理
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这个比较麻烦,要是作为参数传入,那就没法和SHA 256一样循环处理,必须把所有压缩轮都列出来。
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# RORXL
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这是循环右移,SM3使用循环左移,没看到有ROLXL这样的指令,应该能传入负数来实现,
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实在不行只能用MOVL + ROLL来处理,但性能就没啥提高了。
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# 主流程
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如果只有(只剩)一个block (64字节),则只处理这个block,否则2个block(128字节)处理,两个block并行处理message scheduler。
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